Verilog HDL数字集成电路设计原理与应用（第二版）学习指导和实验例程 / 高等学校电子信息类专业十三五规划教材
作者： 蔡觉平，翁静纯，冯必先
出版时间：2016年8月
出版社：西安电子科技大学出版社
- 西安电子科技大学出版社
- 9787560641768
- 152621
- 2016年8月
- 未分类
- 未分类
- TN431.2
蔡觉平、翁静纯、冯必先编著的《Verilog HDL数字集成电路设计原理与应用(第二版)学习指导和实验例程(高等学校电子信息类专业十三五规划教材)》结合“十二五”普通高等教育本科国家级规划教材《Verilog HDL数字集成电路设计原理与应用(第二版)》(蔡觉平等，西安电子科技大学出版社，2016)，以习题和实验例程的方式，对采用VerilogHDL的数字集成电路和FPGA设计方法进行了介绍，同时对教材中的课后习题也一一给予了解答。书中实验例程多，可综合和测试针对性强，且大部分内容来源于工程案例，通过对理论教学的归纳和总结，进一步加强了设计的可参考性，因此，本书主要用于Verilog HDL数字集成电路的实验教学中。
本书可作为研究生和本科生的实验教材，也可作为数字集成电路设计工程师的参考书。
第1章 Verilog HDL数字集成电路设计方法概述
1.1 数字集成电路的发展和设计方法的演变
1.2 硬件描述语言
1.3 Verilog HDL的发展和国际标准
1.4 Verilog HDL和VHDI
1.5 Verilog HDL在数字集成电路设计中的优点
1.6 功能模块的可重用性
1.7 IP核和知识产权保护
1.8 Verilog HDL在数字集成电路设计流程中的作用
教材思考题和习题解答
第2章 Verilog HDL基础知识
2.1 Verilog HDL的语言要素
2.2 数据类型
2.3 运算符
2.4 模块
教材思考题和习题解答
第3章 Verilog HDL程序设计语句和描述方式
3.1 数据流建模
3.2 行为级建模
3.3 结构化建模
教材思考题和习题解答
第4章 Verilog HDL数字逻辑电路设计方法
4.1 Verilog HDL的设计思想和可综合特性
4.2 组合电路的设计
4.2.1 数字加法器
4.2.2 数据比较器
4.2.3 数据选择器
4，2.4 数字编码器
4.2.5 数字译码器
4.2.6 奇偶校验器
4.2.7 其它类型的组合电路
4.3 时序电路的设计
4.3.1 触发器
4.3.2 计数器
4.3.3 移位寄存器
4.3.4 序列信号发生器
4.3.5 分频器
4.4 有限同步状态机
教材思考题和习题解答
第5章 仿真验证与Testbonch编写
5.1 Verilog HDL电路仿真和验证概述
5.2 Verilog HDL测试程序设计基础
5.2.1 组合逻辑电路仿真环境
5.2.2 时序逻辑电路仿真环境
5.3 与仿真相关的系统任务
5.3.1 $display和$write
5.3.2 $monitor和$strobe
5.3.3 $time和$realtime
5.3.4 $finish和$stop
5.3.5 $readmernh和$readmemb
5.3.6 $random
5.4 信号时间赋值语句
5.4.1 时间延迟的描述形式
5.4.2 边沿触发事件控制
5.4.3 电平敏感事件控制
5.5 任务和函数
5.5.1 任务(task)
5.5.2 函数(function)
5.5.3 任务与函数的区别
5.6 典型测试向量的设计
5.6.1 变量初始化
5.6.2 数据信号测试向量的产生
5.6.3 时钟信号测试向量的产生
5.6.4 总线信号测试向量的产生
5.7 用户自定义元件模型
5.7.1 组合电路UDP元件
5.7.2 时序电路UDP元件
5.8 基本门级元件和模块的延时建模
5.8.1 门级延时建模
5.8.2 模块延时建模
5.8.3 与时序检查相关的系统任务
5.9 编译预处理语句
5.10 Verilog HDL测试方法简介
教材思考题和习题解答
第6章 Verilog HDL高级程序设计举例
6.1 Verilog HDL典型电路设计
6.1.1 向量乘法器
6.1.2 除法器
6.1.3 相关器
6.1.4 键盘扫描程序
6.1.5 查找表矩阵运算
6.1.6 巴克码相关器设计
6.1.7 数字频率计
6.1.8 简易微处理器的设计
6.2 FPGA与DSP外部拓展接口(XmTF)通信举例
6.3 FPGA从ADC采集数据举例
6.4 FPGA最大功耗测试
教材思考题和习题解答
第7章 仿真测试工具和综合工具
教材思考题和习题解答
附录 模拟试题
模拟试题(一)
模拟试题(二)
模拟试题(三)
模拟试题(四)
参考文献
